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EP2C20256C7N - Altera Corporation - 1. aumentó la hoja de datos de los dispositivos de la configuración (EPC4, EPC8, y EPC16)

EP2C20256C7N - Altera Corporation - 1. Enhanced Configuration Devices (EPC4, EPC8, and EPC16) Data Sheet

Datos del producto:

Lugar de origen: FILIPINO
Nombre de la marca: Altera Corporation
Certificación: Lead free / RoHS Compliant
Número de modelo: EP2C20256C7N

Pago y Envío Términos:

Cantidad de orden mínima: 5 piezas
Precio: Contace sales group 1
Detalles de empaquetado: Embalaje estándar
Tiempo de entrega: 2-3 DÍAS
Condiciones de pago: T/T por adelantado, Paypal, Western Union
Capacidad de la fuente: 5000
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Descripción detallada del producto

Detalle rápido:

 

Hoja de datos aumentada de los dispositivos de la configuración (EPC4, EPC8, y EPC16)

 

 

Descripción:

 

El dispositivo aumentado Altera de la configuración es un solo-dispositivo, solución de alta velocidad, avanzada de la configuración para FPGAs muy de alta densidad. La base de un dispositivo aumentado de la configuración se divide en dos bloques importantes: un regulador de la configuración y memoria Flash. Memoria Flash se utiliza para almacenar los datos de configuración para los sistemas hechos

encima de uno o más Altera FPGAs. Las porciones inusitadas de memoria Flash se pueden utilizar para almacenar el código o los datos del procesador que se pueden alcanzar vía el interfaz de destello externo después de que la configuración de FPGA sea completa. El cuadro 1-1 resume las características de los dispositivos de la configuración de Altera y la cantidad de espacio de configuración que llevan a cabo.

 

Usos:

Este capítulo describe el EPC4, el EPC8, y los dispositivos aumentados EPC16 de la configuración (EPC).

Solución monopastilla de la configuración del ■ para los dispositivos de Altera® ACEX® 1K, de APEX™ 20K (APEX incluyendo 20K, APEX 20KC, y APEX 20KE), de APEX II, de Arria® GX, de Cyclone®, del ciclón II, de FLEX® 10K (FLEXIÓN incluyendo 10KE y FLEXIÓN 10KA), de Mercury™, de Stratix® II, y de Stratix II GX

El ■ contiene 4, 8, y memorias Flash 16-Mbit para el almacenamiento de datos de configuración

la característica de la descompresión del En-microprocesador del ■ casi dobla la densidad eficaz de la configuración

De destello estándar del ■ mueren y un regulador muere combinado en el solo paquete apilado del microprocesador

El interfaz de destello externo del ■ apoya la programación paralela del flash y del externo

acceso del procesador a las porciones inusitadas de memoria

Bloque de memoria Flash del ■/capacidad de la protección del sector vía interfaz de destello externo

■ apoyado en los dispositivos EPC16 y EPC4

Ayuda del modo de página del ■ para la reconfiguración remota y local con hasta ocho

configuraciones para el sistema entero

■ compatible con la característica de configuración de sistema remoto de la serie de Stratix

El ■ apoya la voz pasiva byte-ancha (FPP) paralelo del modo de la configuración rápidamente; salida de datos de 8 bits por ciclo de DCLK

El ■ apoya la configuración concurrente del n-pedazo verdadero (n = 1, 2, 4, y 8) de Altera FPGAs

ms Pin-a elección 2 o 100 del ■ ms poder-en el tiempo de (POR) del reset

El reloj de la configuración del ■ apoya fuente de entrada y síntesis programables de la frecuencia

Fuentes múltiples del reloj de la configuración del ■ apoyadas (perno interno de la entrada del oscilador y de reloj del externo)

Fuente externa del reloj del ■ con frecuencias hasta 100 megaciclos

Defectos internos del oscilador del ■ a 10 megaciclos; Programable para frecuencias más altas de 33, 50, y 66 megaciclos

Síntesis del reloj del ■ apoyada vía contador programable de la divisoria del usuario

■ disponible en el paquete plano (PQFP) del patio plástico de 100 pernos y los 88 paquetes ultra FineLine del perno BGA® (UFBGA)

Migración vertical del ■ entre todos los dispositivos apoyados en 100 el paquete del perno PQFP

Voltaje de fuente del ■ de 3,3 V (base y entrada-salida)

Hardware del ■ obediente con la especificación 1532 de (ISP) de la programabilidad del en-sistema del estándar de IEEE

El ■ apoya la ISP vía la prueba estándar y el lenguaje de programación (STAPL) del atasco

El ■ apoya la exploración del límite de JTAG

el perno del nINIT_CONF del ■ permite la instrucción privada de JTAG de comenzar la configuración de FPGA

El ■ interno levanta el resistor en el nINIT_CONF permitido siempre

Internos débiles programables del usuario del ■ levantan los resistores en nCS y pernos de OE

Débiles internos del ■ levantan los resistores en la dirección y las líneas de control de destello externas, asimiento del interfaz del autobús en líneas de datos

Modo espera del ■ con el consumo de energía reducido

Para más información sobre esquemas de la configuración de FPGA y características avanzadas, refiera al capítulo apropiado de la familia de FPGA en el manual de la configuración.

 

 

Especificaciones:

 

Fotos del producto

paquete 256-FBGA

Módulos de entrenamiento de producto

Tres razones para utilizar FPGA en diseños industriales

Paquete estándar

90

Categoría

Circuitos integrados (ICs)

Familia

Integrado - FPGAs (arsenal de puerta programable del campo)

Serie

Cyclone® II

Número de laboratorios/CLBs

1172

Número de elementos de lógica/de células

18752

Pedazos totales de la RAM

239616

Número de I /O

152

Número de puertas

-

Voltaje - fuente

1,15 V ~ 1,25 V

Tipo del montaje

Soporte superficial

Temperatura de funcionamiento

0°C ~ 85°C

Paquete/caso

256-BGA

Paquete del dispositivo del proveedor

256-FBGA (17x17)

Página del catálogo

569 (PDF CN081)

Para el uso con

P0528-ND - REVELADOR DE1 ALTERA DEL TABLERO
544-1736-ND - EQUIPO EP2C20N del ARRANCADOR del CICLÓN II

Otros nombres

544-1659

 

 

Ventaja competitiva:

 

Garantía: ¡180 días!
Envío gratis: Orden sobre el triunfo $1000 una tarifa gratuita del envío
(peso de las mercancías debajo de 3Kg), durante 20130901-20130930.


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