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Xilinx programable del chip CI XC9536XL-10VQG64C- - familia de alto rendimiento de XC9500XL CPLD

Xilinx programable del chip CI XC9536XL-10VQG64C- - familia de alto rendimiento de XC9500XL CPLD

Programmable IC Chip XC9536XL-10VQG64C- xilinx - XC9500XL High-Performance CPLD Family

Datos del producto:

Lugar de origen: FILIPINO
Nombre de la marca: xilinx
Certificación: Lead free / RoHS Compliant
Número de modelo: XC9536XL-10VQG64C

Pago y Envío Términos:

Cantidad de orden mínima: 50
Precio: Contact for Sample
Detalles de empaquetado: Contacto para la muestra
Tiempo de entrega: dentro de 3días
Condiciones de pago: T/T por adelantado, Paypal, Western Union
Capacidad de la fuente: 5000
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Descripción detallada del producto


Detalle rápido:
Familia de alto rendimiento de XC9500XL CPLD
Descripción:
La familia de FastFLASH XC9500XL es una familia de 3.3V CPLD apuntada para los usos de alto rendimiento, de baja tensión en comunicaciones marginales y los sistemas de cálculo, donde está importante la alta disipación de la confiabilidad y de energía baja del dispositivo. Cada en-sistema de las ayudas del dispositivo de XC9500XL que programa (ISP) y la límite-exploración completa de IEEE Std 1149,1 (JTAG), permitiendo al superior elimina errores y diseña de la capacidad de la iteración para los pequeños paquetes del factor de forma. Diseñan a la familia de XC9500XL para trabajar de cerca con las familias de Xilinx® Virtex®, del Spartan®-XL y de XC4000XL FPGA, permitiendo que los diseñadores de sistema dividan lógica óptimo entre el conjunto de circuitos rápido del interfaz y la lógica de fines generales de alta densidad. Tal y como se muestra en del cuadro 1, la densidad de la lógica de los dispositivos de XC9500XL se extiende a partir del 800 a 6400 puertas usables con 36 a 288 registros, respectivamente. Las opciones múltiples del paquete y la capacidad asociada de la entrada-salida se muestran en el cuadro 2. Los miembros de la familia de XC9500XL son completamente perno-compatibles, permitiendo la migración fácil del diseño a través de opciones múltiples de la densidad en una huella dada del paquete.
Las características arquitectónicas de XC9500XL dirigen los requisitos de la programabilidad del en-sistema. Aumentado la perno-fijación de capacidad evita la reanudación costosa del tablero. el En-sistema que programa en el rango de operación comercial completo y un alto grado programado de la resistencia proporcionan reconfiguraciones preocupación-libres de las mejoras en el campo del sistema. La retención extendida de los datos apoya vida útil de un sistema más largo y más confiable.
Las características de sistema avanzadas incluyen control de tarifa de ciénaga de la salida y los pernos de tierra usuario-programables para ayudar a reducir ruido del sistema. Cada perno del usuario es compatible con las entradas 5V, 3.3V, y 2.5V, y las salidas se pueden configurar para la operación 3.3V o 2.5V. El oscilación completo simétrico del voltaje de salida 3.3V de los objetos expuestos del dispositivo de XC9500XL para dar un plazo de subida y de tiempos de caída equilibrados.
Usos:
• Optimizado para los sistemas de alto rendimiento 3.3V
- 5 retrasos de la lógica del perno-a-perno del ns, con frecuencia del sistema interno hasta 208 megaciclos
- Pequeños paquetes de la huella incluyendo VQFPs, TQFPs y CSPs (paquete de la escala del microprocesador)
- disponible Pb-libre para todos los paquetes
- Operación de un poder más bajo
- los pernos tolerantes de la entrada-salida 5V aceptan las señales 5V, 3.3V, y 2.5V
- capacidad de la salida 3.3V o 2.5V
- Tecnología avanzada del tamaño de característica de 0,35 micrones Cmos FastFLASH
• Características de sistema avanzadas
- En-sistema programable
- Perno-fijación y routability superiores con la matriz de interruptor de FastCONNECT II
- Extraordinariamente de par en par 54 bloques de la función de entrada
- Hasta 90 producto-términos por macrocell con la asignación individual del producto-término
- Inversión del reloj local con tres relojes globales y de un producto-término
- La salida individual permite por hacer salir el perno con la inversión local
- Entre la histéresis en todas las entradas del perno del usuario y de la límite-exploración
- conjunto de circuitos del Autobús-asimiento en todas las entradas del perno del usuario
- Ayudas caliente-que tapan capacidad
- Ayuda completa de la límite-exploración de IEEE Std 1149,1 (JTAG) en todos los dispositivos
• Cuatro densidades perno-compatibles del dispositivo
- 36 a 288 macrocells, con 800 a 6400 puertas usables
• Programación concurrente rápida
• Control de tarifa de ciénaga en salidas individuales
• Rasgos de seguridad aumentados de los datos
• Calidad y confiabilidad excelentes
- 10.000 programas/el borrado completa un ciclo el grado de la resistencia
- retención de 20 datos del año
• Pin-compatible con 5V la familia de la base XC9500 en huellas comunes del paquete
Especificaciones:

Fichas técnicas

XC9536XL

Fotos del producto

XC9536XL-10VQG64C

Paquete estándar

160

Categoría

Circuitos integrados (ICs)

Familia

Integrado - CPLDs (dispositivos de lógica programable complejos)

Serie

XC9500XL

Empaquetado

Bandeja

Tipo programable

En el sistema programable (ciclos mínimos del programa 10K/del borrado)

Tpd del tiempo de retraso (1) máximo

10.0ns

Fuente del voltaje - interna

3 V ~ 3,6 V

Número de elementos de lógica/de bloques

2

Número de Macrocells

36

Número de puertas

800

Número de I /O

36

Temperatura de funcionamiento

0°C ~ 70°C

Tipo del montaje

Soporte superficial

Paquete/caso

64-TQFP

Paquete del dispositivo del proveedor

64-VQFP (10x10)

Página del catálogo

565 (PDF CN081)

Otros nombres

122-1435
XC9536XL10VQG64C


Ventaja competitiva:
Garantía: ¡180 días!
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(peso de las mercancías debajo de 3Kg), durante 20130901-20130930.
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